P87C51RC1B P87C51RC1A P87C51RC14N P87C51RC-1 P87C51RC1 P87C51RC+JN P87C51RC+JA P87C51RC+IN P87C51RC+IB P87C51RC+IA P87C51RC24
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80C51 CPU；32KB 512字節(jié)RAM；布爾處理器；全靜態(tài)操作；低壓(2.7～5.5V在16MHz時)操作；具有可選的6個時鐘操作的12個時鐘操作；存儲地址能力：達(dá)到64KB ROM和64KB RAMI、電源控制模式：時鐘可以停止和恢復(fù)；閑置模式；掉電模式；COMS和TTL兼容；2個速度范圍在Vcc＝5V時：0～3OMHz具有6個時鐘操作；0～33MHz具有12個時鐘操作；并行可編程具有87C51兼容硬件接口；RAM可擴(kuò)充外部至64KB；可編程計(jì)數(shù)器陣列(PCA)：PWM；捕獲/比較；PLCC和LQFP封裝；擴(kuò)展溫度范圍：雙數(shù)據(jù)指針；安全位(3位)；加密陣列64KB；7個中斷源；4個中斷優(yōu)先級別；4個8位I/O端口；全雙工增強(qiáng)UART；幀錯誤檢驗(yàn)；自動地址識別；3個16位定時器/計(jì)數(shù)器T0，T1(標(biāo)準(zhǔn)80C51)和額外的2(捕獲和比較)；可編程的時鐘輸出引腳；異步端口復(fù)位；通過外部中斷從掉電中喚醒個中斷源；在個中斷優(yōu)先級別；4個8位I/O端口；全雙工增強(qiáng)UART；幀錯誤檢驗(yàn)；自動地址識別；3個16位定時器/計(jì)數(shù)器T0，T1(標(biāo)準(zhǔn)80C51)和額外的2(捕獲和比較)；可編程的時鐘輸出引腳；異步端口復(fù)位；通過外部中斷從掉電中喚醒
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