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解析ADSP-BF531的數(shù)字音頻選擇系統(tǒng)的應(yīng)用
往往是平衡式的，意在保障盡可能高的信號源質(zhì)量，減輕傳輸中的干擾。aes/ebu數(shù)字音頻接口標(biāo)準(zhǔn)采用一個(gè)雙相標(biāo)識(shí)（biphase mark）的調(diào)頻通道編碼調(diào)制串行數(shù)據(jù)，使之無直流（dc-free）和自同步（self-clocking）。調(diào)頻編碼中，每一個(gè)數(shù)據(jù)碼轉(zhuǎn)換為兩位通道碼，一位通道碼1引起傳輸信號的一次變化。未經(jīng)加工的串行數(shù)據(jù)不能直接通過電纜傳輸，必須調(diào)制（編碼）使之成為一種含有與碼值無關(guān)的時(shí)鐘信號波形。aes3的幀格式如圖2所示。 4系統(tǒng)硬件設(shè)計(jì) 4.1分配板卡分配板主要包括cs8420、max3095、adsp-bf531以及cpld等器件，cpld（complex programmable logic device）復(fù)雜可編程邏輯器件，是從pal和gal器件發(fā)展出來的器件，相對而言規(guī)模大，結(jié)構(gòu)復(fù)雜，屬于大規(guī)模集成電路范圍。是一種用戶根據(jù)各自需要而自行構(gòu)造邏輯功能的數(shù)字集成電路。其基本設(shè)計(jì)方法是借助集成開發(fā)軟件平臺(tái)，用原理圖、硬件描述語言等方法，生成相應(yīng)的目標(biāo)文件，通過下載電纜（"在系統(tǒng)"編程）將代碼傳送到目標(biāo)芯片中，實(shí)現(xiàn)設(shè)計(jì)的數(shù)字系統(tǒng)。分配板卡信號電路連接如圖3所示。

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靈活的3線串行數(shù)字輸入/輸出端口；8～108kHz采樣率范圍；1：3和3：1最大輸入到輸出采樣率比率；128dB動(dòng)態(tài)范圍－117dB THD＋N在1kHz時(shí)；24位I/O字；引腳和微控制器讀/寫存取通道狀態(tài)和用戶數(shù)據(jù)；微控制器和獨(dú)立模式

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