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  • 電源時序控制

    這種情況下,內(nèi)部靜電放電(esd)二極管變?yōu)檎?,進而使模擬電源上電。為解決這個問題,輸入和/或基準(zhǔn)電壓源在adc上電時應(yīng)處于未上電或未連接狀態(tài)。 同樣,數(shù)字輸入電壓范圍為?0.3 v至dvdd + 0.3 v.這說明,數(shù)字輸入必須小于dvdd + 0.3 v.因此,在上電時,dvdd必須先于微處理器/邏輯接口電路或與之同時上電。 與上述模擬內(nèi)核情況相似,這些引腳上的esd二極管也可能變?yōu)檎?,使?shù)字內(nèi)核上電到未知狀態(tài)。 ad7621、ad7622、ad7623、ad7641和ad7643等pulsaradc速度更快,是該系列的新型器件,采用更低的2.5 v電源(ad7654則采用5 v電源)。ad7621和ad7623具有明確規(guī)定的上電序列。表2摘自ad7621 (rev. 0)數(shù)據(jù)手冊的"絕對最大額定值"部分。 表2. ad7621的絕對最大額定值(rev. 0) 同樣,ovdd與dvdd之間存在限制。"絕對最大額定值"規(guī)定:ovdd必須小于或等于dvdd + 0.3 v,而dvdd則必須小于2.3 v.一旦dvdd在上電期間達(dá)到2.3 v,該限制便不再適用。如果

  • AD7643

    AD7643引腳圖吞吐率:1.25MSPS;INL:±1.5 LSB標(biāo)準(zhǔn)值,±3 LSB最大值(±11×10 -6全標(biāo)度);18位分辨率,無失碼;動態(tài)范圍:95dB標(biāo)準(zhǔn)值;S/(N+D):93.5dB標(biāo)準(zhǔn)值、20kHz(VREF=2.5V);THD:-113dB標(biāo)準(zhǔn)值、20kHz(VREF=2.5V);2.048V內(nèi)部參考:典型漂移8×10 -6/℃;TEMP輸出;差分輸入范圍:±VREF(VREF高達(dá)2.5V);無管道延遲(SAR結(jié)構(gòu));并行(18,16或8位總線)和串行5V/3.3V/2.5V接口;SPI ®/QSPI TM/MICROWIRETM /DSP兼容;單2.5V電源操作;功耗:65mW標(biāo)準(zhǔn)值、1.25MSPS帶有內(nèi)部基準(zhǔn);2μW斷電模式;48引腳LQFP封裝;引腳兼容AD7641和其他PulSAR模數(shù)轉(zhuǎn)換器

ad7643替代型號

AD7631 AD7628 AD7621 AD7610BSTZ AD760AQ AD760 AD759P AD759N AD7591 AD7582

AD7654 AD7654ASTRL AD7655 AD7655ASTRL AD7656 AD7657 AD7660 AD7661 AD7663 AD7664ASTRL

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