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實(shí)際的同步管道突發(fā)式SRAM
下面我們看一下實(shí)際的同步管道突發(fā)式sram，這次我們作為實(shí)例的產(chǎn)晶是cypress公司的128k×36位的cy7c1347b。之所以采用36位而不是32位，是因?yàn)榭紤]到每隔8位（一個(gè)字節(jié)）能進(jìn)行驗(yàn)證的情況。 cy7c1347b的內(nèi)部框圖如圖1所示，信號(hào)種類如圖2所示。這些信號(hào)除了以一字節(jié)為單位進(jìn)行寫人操作的bw″信號(hào)以外，還包括進(jìn)行onjl位整體寫入操作的gw。在cpu的突發(fā)周期中，當(dāng)可以一次性更新1字大小（36位）的數(shù)據(jù)時(shí)使用gw；當(dāng)從外部更新1字節(jié)或2字節(jié)大小的數(shù)據(jù)時(shí)使用bw刀信號(hào)，這樣就可以只更新相應(yīng)的字節(jié)數(shù)據(jù)。另外，用于地址鎖存的信號(hào)包括adsc和adsp兩個(gè)信號(hào)，adsc用于來(lái)自緩存控制器的存取；adsp用于來(lái)自處理器的存取。adsp與adsc在寫存取時(shí)的處理上存在若干不同，這將在以后進(jìn)行說(shuō)明。圖1 cy7c1347b的內(nèi)部框圖圖2 cy7c1347b的信號(hào) 與主存儲(chǔ)器相比，高速緩沖存儲(chǔ)器被要求快速操作。因此為了盡可能不在外部對(duì)控制信號(hào)進(jìn)行處理，所以準(zhǔn)備了多個(gè)類似這樣用于存取的信號(hào)。例如，通常情況下，cpu的ads（地址選通）信號(hào)與adsp信號(hào)直
實(shí)際的同步突發(fā)式SRAM
我們將cypress公司的cy7c1345b作為同步突發(fā)式sram的實(shí)例，它具有與cy7c1347b相同的128k×36位的結(jié)構(gòu)，其內(nèi)部框圖如圖所示。由框圖可知，與cy7c1347b相比，除了沒(méi)有輸出寄存器以外，其他完全相同，只是將控制信號(hào)等bwn改名為bwsn，其他方面完全相同，請(qǐng)參照同步管道突發(fā)式sram的說(shuō)明。圖 cy7c1347b的內(nèi)部框圖另外，從框圖我們可知，同步突發(fā)式sram的寫人周期與同步管道突發(fā)式sram的相同，所以在此我們只說(shuō)明讀操作。來(lái)源:ks99
同步管道突發(fā)式SRAM的基本操作
同步管道突發(fā)式sram的操作基本上都是與時(shí)鐘的上升沿同步進(jìn)行的，因此最好能夠看到時(shí)鐘沿的狀態(tài)。在功能方面看上去非常復(fù)雜，但時(shí)序的讀取比異步sram還是簡(jiǎn)單的。 1. 同步管道突發(fā)式sram的周期定義由于都是與時(shí)鐘同步的，所以可以通過(guò)時(shí)鐘沿中各個(gè)控制線的狀態(tài)確定下一個(gè)狀態(tài)。表表示cy7c1347b的周期定義。表同步管道突發(fā)式sram的周期定義從器件的內(nèi)部框圖以及ce3、ce2、ce1一欄可以看出，這些使能引腳是在操作開(kāi)始時(shí)刻被利用的，而一旦開(kāi)始進(jìn)行讀或者寫操作，則這些引腳就不再被利用。 2. 讀操作1：?jiǎn)我蛔x 所謂的單一讀操作，就是讀出所希望讀取的地址數(shù)據(jù)，與異步sram的處理相同。其操作波形如圖1所示，如果在最初的時(shí)鐘沿上讓芯片發(fā)揮使能，并且賦予地址，那么將在2個(gè)時(shí)鐘后讀出數(shù)據(jù)，只要在外部電路鎖存該數(shù)據(jù)即可。圖1 單一讀操作起始地址在最初的adsp時(shí)鐘時(shí)被鎖存，開(kāi)始對(duì)存儲(chǔ)器單元進(jìn)行存取操作，然后在下一個(gè)時(shí)鐘從存儲(chǔ)器中輸出數(shù)據(jù)，進(jìn)而在下一個(gè)時(shí)鐘將數(shù)據(jù)提取至輸出緩沖器的鎖存器中。對(duì)于單一讀只要具有這個(gè)印象即可。 2.
同步管道突發(fā)式SRAM的各種信號(hào)
cy7cl347b所具有的各種信號(hào)及其意義如下所述，基本上各種信號(hào)都是在時(shí)鐘（clk）信號(hào)的上升沿被采樣的。 1. a0～a16（地址）這是地址輸入。cy7c1347b的數(shù)據(jù)具有36位，這是每8位數(shù)據(jù)＋1位驗(yàn)證的結(jié)構(gòu)，共有4字節(jié)大小。由于普通的處理器是以8位為單位進(jìn)行輸人輸出的，所以一般都是a0連接cpu的a2、a1連接a3這樣的形式。突發(fā)傳輸時(shí)，根據(jù)內(nèi)部的突發(fā)式計(jì)數(shù)器，a0與a1被自動(dòng)更新。異步sram的情況下，由于只要能從寫入的地址中讀出數(shù)據(jù)即可，所以地址引腳即使顛倒連接也不會(huì)出現(xiàn)問(wèn)題。但是在同步管道突發(fā)式sram的情況下，如果a0及a1引腳顛倒連接，則在突發(fā)傳輸中將出現(xiàn)異常，因此一定要明確地將a0作為lsb使用。 2. bw0～bw3（byte write select）這是1字節(jié)（實(shí)際上為9位）的數(shù)據(jù)寫控制信號(hào)。時(shí)鐘上升時(shí)，當(dāng)bwe信號(hào)有效（低電平）日寸，其中對(duì)應(yīng)于有效（已成為低電平）信號(hào)字節(jié)部分的數(shù)據(jù)將成為要更新的對(duì)象。bw0對(duì)應(yīng)于lsb一端（dq0～dq7及dp0），bw3對(duì)應(yīng)于msb一端（dq24～dq31及dp3）。 3. gw（globl

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