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在無線數(shù)傳接收設(shè)備中，數(shù)據(jù)轉(zhuǎn)存系統(tǒng)是實現(xiàn)數(shù)據(jù)接收存儲的關(guān)鍵子系統(tǒng)。下面將詳細介紹該系統(tǒng)的硬件實現(xiàn)及工作過程。2 數(shù)據(jù)轉(zhuǎn)存系統(tǒng)基本構(gòu)成及硬件實現(xiàn) 數(shù)據(jù)轉(zhuǎn)存系統(tǒng)主要由fpga模塊、dsp模塊、usb2.0接口芯片構(gòu)成，各個模塊之間的相互關(guān)系如圖2所示示。圖中，4mb/s的串行數(shù)據(jù)輸入信號sdi已由rs-422差分電平轉(zhuǎn)換為cmos電平。為突出重點，不太重要的信號連線未在圖中繪出。下面分別介紹這幾個模塊的主要功能。 2.1 fpga模塊實現(xiàn)及春功能 fpga模塊在altera公司acex系列的ep1k30ti144-2芯片中實現(xiàn)。其中主要的功能子模塊有：位同步邏輯、幀同步邏輯、授時時鐘和譯碼邏輯。位同步邏輯主要由數(shù)字鎖相環(huán)構(gòu)成，用于從串行數(shù)據(jù)輸入信號sdi中恢復出位時鐘信號。幀同步邏輯從位同步邏輯的輸出信號提取幀同步脈沖。兩者為dsp利用其同步串行口接收串行數(shù)據(jù)作好準備。這樣，利用一對差分信號線就可以接收同步串行數(shù)據(jù)，簡化了印制電路板的外部接口。授時時鐘在dsp和gsp接收機的協(xié)助下生成精度為0.1ms的授時信息。譯碼邏輯用于實現(xiàn)系統(tǒng)互聯(lián)。 2.2 dsp模塊實現(xiàn)及其功能 dsp模塊是數(shù)據(jù)轉(zhuǎn)存系統(tǒng)的主控模
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