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號進行計數(shù)并選擇合適的計數(shù)值,同時時鐘信號的計數(shù)值滿足要求時,才輸出高電平。而對于周期和高電平均小于20ms的信號,則只需考慮對于時鐘信號的計數(shù),選擇合適的計數(shù)值使cpld輸出高電平即可。 激光發(fā)射信號調(diào)制系統(tǒng)組成 本激光發(fā)射信號調(diào)制系統(tǒng)從結(jié)構(gòu)上主要由三個部分組成:同步控制、頻率及占空比調(diào)節(jié)以及調(diào)制信號產(chǎn)生部分。系統(tǒng)結(jié)構(gòu)框圖如圖1所示。 圖1 激光發(fā)射信號調(diào)制系統(tǒng)結(jié)構(gòu)框圖 脈沖調(diào)制信號產(chǎn)生部分是本系統(tǒng)的核心。信號由一片cpld產(chǎn)生,該芯片選用max3000a系列的epm3128atc100-10,且此芯片內(nèi)部有2500個可用門數(shù),128個宏單元,8個邏輯塊,只要設(shè)計合理,芯片資源足夠設(shè)計使用。系統(tǒng)中脈沖調(diào)制信號的產(chǎn)生均是對此芯片編程實現(xiàn)的,而系統(tǒng)的其它部分僅對信號的產(chǎn)生起控制作用。 對于系統(tǒng)的各控制部分,系統(tǒng)開關(guān)控制調(diào)制系統(tǒng)是否工作。頻率及占空比控制部分是系統(tǒng)的主要控制部分,所需脈沖信號的頻率及占空比通過鍵盤輸入控制cpld,實現(xiàn)頻率及占空比動態(tài)調(diào)節(jié)。其中,頻率調(diào)節(jié)范圍在1hz~1khz,頻率間隔則需要在系統(tǒng)應(yīng)用前對cpld編程設(shè)定。占空比分為四檔,分別為1:1、1:4、1:9和
將dsp地址線中低15位直接與flash中的a0~a14相連,地址高3位通過cpld來控制尋址。為了對存儲器進行統(tǒng)一的邏輯控制,本系統(tǒng)由cpld并完成片選、中斷、復(fù)位、讀寫使能等功能 2.2 cpld電路的設(shè)計 cpld作為接口和邏輯控制器件,其內(nèi)部集成有地址發(fā)生器和與dsp的握手控制電路,可用于完成整個系統(tǒng)的片選、中斷、通用i/o的配置等功能,同時可將指紋圖像直接存儲到sram中,并在采集完一幅圖像后通知dsp數(shù)據(jù)已準(zhǔn)備好。本設(shè)計中的cpld選用美國altera公司的max3000系列epm3128atc100-10。 2.3 鍵盤與lcd電路的設(shè)計 lcd模塊采用fm12864i作為指紋圖形和處理結(jié)果顯示的用戶界面。fm12864i是一種圖形點陣液晶顯示器,它主要由行驅(qū)動器/列驅(qū)動器及128×64全點陣液晶顯示器組成,可完成圖形顯示,也可以顯示8×4個(16×16點陣)漢字。本設(shè)計為了便于調(diào)試,將dsp輸出與lcd連接的控制引腳一起連人cpld,便以靈活地調(diào)整時序。鍵盤上有12個按鍵,可用10 kω電阻拉高組成3×4鍵盤,輸出的邏輯電平與cpld的i/o相連,并通過vhdl程序來控制鍵值的讀入。
if; 2.3 仿真結(jié)果 把自主開發(fā)的ip核置于max+plus ii 10.0開發(fā)環(huán)境下,選用epm3128atc100-10器件,經(jīng)過編譯、調(diào)試與仿真,證明該程序符合設(shè)計要求。圖4是模擬產(chǎn)生開始信號并傳輸兩組二進制數(shù)據(jù)"10011001"和"10101010"(十進制表示為153和170)的仿真波形。圖5是傳輸數(shù)據(jù)"10011001"后沒有應(yīng)答時的仿真結(jié)果,此時總線處于暫停狀態(tài)。 仿真完成后,通過編程電纜將pof文件下載到實際電路的epm3128atc100-10epm3128atc100-10中,然后對ad9883ad9883進行初始化,結(jié)果工作正常,這進一步驗證了采用該自主開發(fā)的ip核完全可滿足i2c總線的時序要求,能實現(xiàn)i2c總線的功能。 參考文獻:[1]. ad9883 datasheet http://udpf.com.cn/datasheet/ad9883_251913.html.[2]. epm3256a datasheet http://udpf.com.cn/datasheet/epm3256a_301030.html.[3]. epm3128atc1