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上升沿到來時(shí),dir進(jìn)行加1計(jì)數(shù),且當(dāng)dir=0xf時(shí),dir的下一狀態(tài)值為0。與此同時(shí),dir加1并賦值給direct。 當(dāng)lamp為低電平時(shí),電梯處于等待狀態(tài),故liftor保持其原值不變保持0和3不變;當(dāng)lamp為高電平時(shí),電梯處于運(yùn)行狀態(tài),因upin始終為高電平,downin始終為低電平,故當(dāng)run_stop為高電平時(shí),電梯只能處于上升狀態(tài),故liffor進(jìn)行自加1計(jì)數(shù),同時(shí),liftor加1賦值給 st_out。 5 硬件實(shí)驗(yàn) 在max+plusii軟件編譯完后,采用epm7128slc84-6器件下載vhdl源程序,進(jìn)行硬件試驗(yàn)。 其下載步驟為:首先,指定采用可編程器件epm7128slc84-6;其次,依據(jù)輸入、輸出端口指定與之對(duì)應(yīng)的引腳;然后,使用pof2jed軟件將編譯后的下載文件*.pof。轉(zhuǎn)換成*.jed文件;最后,使用atmel isp軟件將轉(zhuǎn)換后的*.jed文件轉(zhuǎn)換成*.chn文件。 硬件系統(tǒng)試驗(yàn)表明,輸出信號(hào)的顯示與軟件仿真結(jié)果完全相符,達(dá)到設(shè)計(jì)要求。 6 結(jié)論 該系統(tǒng)軟件設(shè)計(jì)中,成功編譯并仿真vhdl源程序,且對(duì)仿真圖進(jìn)行合理分析。在硬件實(shí)驗(yàn)
'event and clk='1')then if cnt<999 then cnt:=cnt+1; clk1ms<='0'; else cnt:=0; clk1ms<='1'; end if; end if; end process p2; end control; 三、功能仿真及下載驗(yàn)證 各模塊vhdl程序經(jīng)過編譯優(yōu)化后,選擇合適的目標(biāo)芯片進(jìn)行綜合、管腳配置。本電路選用altera公司的可編程邏輯芯片epm7128slc84-6,由max+plus ii進(jìn)行仿真,從仿真波形可以看出,此程序可以實(shí)現(xiàn)四種不同花樣彩燈的相互變換,每種花樣彩燈可以循環(huán)變化。但是如果系統(tǒng)的固有頻率很大,彩燈的閃爍速度非??欤吹降默F(xiàn)象是每個(gè)花樣的八個(gè)彩燈同時(shí)被點(diǎn)亮,為了實(shí)現(xiàn)絢麗多彩的景象,必須要在程序中加一個(gè)分頻進(jìn)程如上述程序的進(jìn)程p2。 四、結(jié)束語 本次設(shè)計(jì)的程序已經(jīng)在硬件系統(tǒng)上得到了驗(yàn)證,實(shí)驗(yàn)表明。此設(shè)計(jì)方法能夠滿足四種不同花樣彩燈的變化要求,并且該方法便于擴(kuò)展不同變化模式的彩燈花樣,各個(gè)不同花樣的相互轉(zhuǎn)變是手動(dòng)切換實(shí)現(xiàn)的。自動(dòng)
2c的時(shí)序要求。要使總線傳輸速率達(dá)到改進(jìn)后的規(guī)范,即400 kb/s,因?yàn)楦鶕?jù)以上敘述,每發(fā)送1位數(shù)據(jù)需要4個(gè)時(shí)鐘周期,所以所給的時(shí)鐘為1600 khz。圖4中execute為執(zhí)行信號(hào),即它為高電平時(shí),輸入數(shù)據(jù)din[7..0]有效;exu為發(fā)送使能信號(hào),只有當(dāng)它為高電平時(shí),方可輸送串行數(shù)據(jù)到外圍器件;start為開始控制信號(hào),用于發(fā)生起始信號(hào);stop用于告知總線數(shù)據(jù)傳輸結(jié)束,發(fā)生停止信號(hào)。圖4 仿真結(jié)果 仿真以后,通過編程電纜將生成的pof文件用isp(在系統(tǒng)編程)方式下載到fpga板e(cuò)pm7128slc84-6,i/o口sda和scl掛上拉電阻,外接兩片i2c器件saa1064(led顯示i2c串入并出芯片)進(jìn)行測(cè)試,結(jié)果cpld利用該i2c的ip核,工作正常,可以按照要求顯示。 來源:零八我的愛
、1表示密碼正確、8表示修改密碼成功。acc為內(nèi)部移位寄存器。臨時(shí)存儲(chǔ)4個(gè)4位二進(jìn)制數(shù),用于暫存用戶輸入的密碼;reg為內(nèi)部移位寄存器,臨時(shí)存儲(chǔ)4個(gè)4位二進(jìn)制數(shù),用于保存密碼;nc為內(nèi)部信號(hào),用于表示當(dāng)前已輸入數(shù)據(jù)數(shù).或者表示用戶按數(shù)字鍵的次數(shù)。 根據(jù)圖5所示的總體仿真圖,可導(dǎo)出密碼控制系統(tǒng)電路,如圖6所示。 4 結(jié)語 本系統(tǒng)設(shè)計(jì)是通過自動(dòng)調(diào)用max-7000s系列的epm7128slc84-6型epga器件來實(shí)現(xiàn)。并且通過系統(tǒng)總體仿真圖能看出設(shè)計(jì)的密碼控制系統(tǒng)完全符合要求。 參考文獻(xiàn):[1]. 110l datasheet http://udpf.com.cn/datasheet/110l_2043496.html.來源:qick
;按下"開啟電器編號(hào)"設(shè)置鍵,再按下要定時(shí)開啟的電器編號(hào),對(duì)應(yīng)發(fā)光二極管亮,表示設(shè)置有效;按下"電器開啟時(shí)間"設(shè)置按鍵;再依次輸入4位十進(jìn)制的小時(shí)和分鐘,作為開啟時(shí)間;按下"電器關(guān)閉時(shí)間"設(shè)置按鍵,再依次輸入4位十進(jìn)制的小時(shí)和分鐘,作為關(guān)閉時(shí)間。至此定時(shí)開關(guān)設(shè)置完成,對(duì)于電飯鍋等具有保持功能的電器,則不用設(shè)置定時(shí)關(guān)閉。使用verilog hdl編寫cpld程序,理論上可同時(shí)設(shè)置多個(gè)電器的定時(shí)自動(dòng)開啟,本設(shè)計(jì)可同時(shí)設(shè)置3個(gè)電器。 3硬件設(shè)計(jì) 硬件設(shè)計(jì)采用altera公司的cpld epm7128slc84-6,簡(jiǎn)化了外圍電路,穩(wěn)定性和可靠性高,成本低。220 v、50 hz工頻電源經(jīng)變壓器、電橋整流后通過三端穩(wěn)壓器,提供工作電壓,其電源電路如圖1所示。 外接4×4鍵盤,使用較少的i/o端口線就可實(shí)現(xiàn)對(duì)較多按鍵的控制。當(dāng)有鍵按下時(shí),kb為低電平,cpld的按鍵掃描部分采用動(dòng)態(tài)掃描方式進(jìn)行識(shí)別。設(shè)置14個(gè)按鍵,分別為0~9十個(gè)數(shù)字鍵和設(shè)定時(shí)間、開啟電器編號(hào)、電器開啟時(shí)間、電器關(guān)閉時(shí)間4個(gè)功能鍵,其余兩個(gè)留作功能擴(kuò)展。4×4鍵盤電路如圖2所示。 本系統(tǒng)設(shè)計(jì)使用6個(gè)數(shù)碼管顯示時(shí)間,3個(gè)
…… 器件用的是epm7128slc84-6