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而是遵循先入先出的原則輸出,在軟件處理上要復(fù)雜一些。fifo一般價(jià)格較貴,且存儲(chǔ)量不大。本設(shè)計(jì)所采用的fifo是nec公司生產(chǎn)的upd42280,其容量為8位256k（實(shí)際是262224）字節(jié),數(shù)據(jù)讀寫(xiě)時(shí)間為30ns,是一種比較理想的fifo芯片。該芯片內(nèi)部采用動(dòng)態(tài)ram結(jié)構(gòu),能夠自動(dòng)刷新,當(dāng)讀寫(xiě)完最后一個(gè)存儲(chǔ)單元后,又會(huì)自動(dòng)回到第一個(gè)存儲(chǔ)單元。由于a/d有13條數(shù)據(jù)線（包括otr位）,所以每路用了兩片fifo來(lái)接收數(shù)據(jù)。 3 dsp主處理器及控制電路主處理器采用的是ti公司生產(chǎn)的tms320c32pcm40。它是一種高性能的32位浮點(diǎn)型數(shù)字信號(hào)處理器,內(nèi)部包括通用寄存器組、程序高速緩沖存儲(chǔ)器、專(zhuān)用輔助寄存器單元（arau）、兩個(gè)存儲(chǔ)器、兩個(gè)dma通道。dsp所具有的高存儲(chǔ)空間（32位/16m）、多處理器接口、內(nèi)部及外部產(chǎn)生的等待狀態(tài)、一個(gè)外部接口端口、兩個(gè)32位定時(shí)器、一個(gè)串行口以及多重中斷結(jié)構(gòu)等,使其應(yīng)用得到了很大的加強(qiáng)。為了加快數(shù)據(jù)流的傳輸,克服瓶頸問(wèn)題,dsp內(nèi)部采用了哈佛總線結(jié)構(gòu)（指令和數(shù)據(jù)有各自存儲(chǔ)空間,尋址或存取數(shù)據(jù)、指令有各自的傳輸總線）而不是通用處理器采用的馮諾依曼結(jié)構(gòu)（指

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