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SOT363/07+
原裝現(xiàn)貨不僅銷售也回收
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種易于開發(fā)、設(shè)計靈活的方案。而這主要得益于ip復(fù)用技術(shù)的發(fā)展。在fpga上構(gòu)建復(fù)雜嵌入式系統(tǒng)可利用既有的功能模塊及其驅(qū)動程序。該方案具有更大的集成度和靈活性，因而必將成為電子設(shè)計發(fā)展的一大趨勢。 本文介紹了采用xilinx公司的spartan-3 fpga實現(xiàn)通用視頻采集系統(tǒng)的設(shè)計方案。該系統(tǒng)外接模擬pal／ntal制式的攝像頭，就能實時采集視頻信號并進行mpeg-4格式壓縮編碼，碼流可通過usb接口傳給pc機，或通過以太網(wǎng)接口進行網(wǎng)絡(luò)傳輸。本系統(tǒng)選用的是spartan-3 fpga系列的xc3s200芯片，該芯片有4320個邏輯單元(lc)、216kbit blockram、4個數(shù)字延遲鎖相環(huán)(ddl)、173個用戶i／o，而且邏輯密度高、i／o多、成本低。本設(shè)計主要涉及電路板級硬件設(shè)計、fpga片級硬件系統(tǒng)設(shè)計和系統(tǒng)軟件設(shè)計。 1 板級硬件設(shè)計 fpga在電源和配置電路的支持下，即可構(gòu)成嵌入式系統(tǒng)的最小化系統(tǒng)，并能實現(xiàn)片內(nèi)的所有功能。在此最小化系統(tǒng)上，就可以根據(jù)本設(shè)計的應(yīng)用需求，來擴展外部存儲模塊、視頻采集模塊、usb接口模塊、以太網(wǎng)接口模塊等功能模塊電路，從而形成電路板級硬件
在移動通信終端、便攜計算機、gps衛(wèi)星定位系統(tǒng)等領(lǐng)域有廣泛用途，成為使用量最大的顯示器件。液晶顯示控制器作為液晶驅(qū)動電路的核心部件通常由集成電路組成，通過為液晶顯示系統(tǒng)提供時序信號和顯示數(shù)據(jù)來實現(xiàn)液晶顯示。本設(shè)計是一種基于fpga(現(xiàn)場可編程門陣列)的液晶顯示控制器。與集成電路控制器相比，fpga更加靈活，可以針對不同的液晶顯示模塊更改時序信號和顯示數(shù)據(jù)。fpga的集成度、復(fù)雜度和面積優(yōu)勢使得其日益成為一種頗具吸引力的高性價比asic替代方案。本文選用xilinx公司的spartan iii系列xc3s200器件，利用硬件描述語言verilog設(shè)計了液晶顯示控制器，實現(xiàn)了替代專用集成電路驅(qū)動控制lcd的作用。 1 功能分析與設(shè)計要求 液晶顯示模塊(lcm)采用深圳拓?fù)湮m2028、stn圖形點陣液晶顯示模塊，5.7 in，320×240點陣，邏輯電壓輸入為3.0～5.0 v，4位控制接口，具有行列驅(qū)動電路，白光led背光源。表1為該液晶顯示模塊的引腳功能描述。 液晶顯示器的掃描方式是逐行掃描，當(dāng)一行被選通以后，這一行中的各列信號同時加到列上，并維持一個掃描行的時間。這一行
圖1 控制系統(tǒng)結(jié)構(gòu)圖 電路由電源模塊，電壓轉(zhuǎn)化模塊，fpca模塊，驅(qū)動電路模塊，斬波電流、電壓檢測模塊，繞組電流檢測模塊，a／d模塊，通信模塊，外擴存儲器模塊等部分組成。 首先，由fpga產(chǎn)生5路pwm波，其中3路用于永磁無刷直流電機換相，1路用于斬波，另1路用于再生能耗調(diào)節(jié)制動電流。三相換相pwm經(jīng)驅(qū)動電路控制電機的換相，這3路pwm只用于換相不進行調(diào)制，由斬波環(huán)節(jié)進行調(diào)制。 電機繞組電流經(jīng)求偏、放大、濾波通過a／d（ads7864）轉(zhuǎn)換進人fpga（xc3s200），經(jīng)pid調(diào)節(jié)器控制電流環(huán)；同樣，斬波電壓電流經(jīng)濾波通過a／d轉(zhuǎn)換也進人fpga。圖2所示為fpca的最小系統(tǒng)電路，xcf02s為fpga xc3s200的配置芯片，tps767d325是電源芯片，將＋5v電源電壓轉(zhuǎn)換為＋2.5v和＋3.3v供給fpga，電源芯片lm317將＋5v電源電壓轉(zhuǎn)換為＋1.2v供給fpga；fpga的時鐘選為50mhz，晶體振蕩器為50mhz有源晶振，輸出的時鐘信號電壓的高電平為＋3.3v。 圖2 斬波器電感電流檢測電路 永磁無刷直流電機
器件的內(nèi)核、接口和dll的電源電壓都是1．8 v，最大電流為440 ma。另外需特別注意ddr2的vref以及地址和控制信號的端口接電壓vtt，其電壓值都是0．9 v。其中，vref對容差的要求非常嚴(yán)格(小于2％)，不過其對電流的要求較小。而對vtt不僅有嚴(yán)格的容差要求，而且還要求其能在瞬間輸出或吸收很大的電流。同時，vref岍要隨著vdd的變化而變化，vtt也要跟蹤vref的變化。通常的ldo難以完成這樣的工作，必須采用專用的ddr端接電源器件。 該系統(tǒng)使用spartan3型fpga器件xc3s200實現(xiàn)1553收發(fā)器以及一些接口電路的設(shè)計。該器件使用3個電壓內(nèi)核電壓vccint(1．2 v)，輔助電壓vccaux(2．5 v)以及接口電壓vcco(3．3 v)。fpga內(nèi)部有上電復(fù)位電路，只有當(dāng)這3個電源信號都達到各自門限電壓，才釋放該復(fù)位信號。因此，對這3個電源信號的上電順序沒有要求。不過，如果 vccint先于vccaux上電，則會在上電時額外增加幾百毫安的瞬時電流。估計fpga器件功耗可采用基于電子數(shù)據(jù)表的工具xpower estimator(xpe)或在ise下直接調(diào)用xpowe
器后得到其電壓量。分x，y兩路輸出給示波器，根據(jù)示波器原理，在屏幕上打點顯示數(shù)字(或者圖形)。而z通道作為另一路獨立通道，對顯示的數(shù)字亮度進行可控顯示。 2 系統(tǒng)硬件設(shè)計 2．1 總體控制模塊 基于本設(shè)計，系統(tǒng)控制模塊的部分是具有掩膜可編程門陣列的邏輯器件——fpga。 spartan系列fpga是xilinx公司可編程邏輯產(chǎn)品中的高性價比產(chǎn)品的代表，而spartan-ⅲ系列fpga是為那些需要大容量、低價格電子應(yīng)用的用戶而設(shè)計的。本系統(tǒng)使用的是xilinx公司的xc3s200型號芯片，其技術(shù)參數(shù)如下： ●4 320個邏輯單元； ●系統(tǒng)門密度200 k個； ●clb陣列24*20，共480個； ●最大用戶i／o173，最大差分i／o76； ●分布式ram容量30 kbit，block ram容量216kbit； ●嵌入式18x18乘法器支持高性能dsp應(yīng)用； ●pci和帶有l(wèi)vds的高速差分信號。 2．2 存儲單元模塊 由于fpga基于cmos sram工藝，不具備掉電保護功能，當(dāng)無電源供電時，配置的數(shù)據(jù)丟失，芯片
個確定的輸入信息找到碰撞，這是因為需要仔細(xì)地選擇輸入信息。 由此分析可明顯看出, 所定義的sha-1算法具有兩點安全性：防碰撞和不可逆性。這些設(shè)備的實用性取決于安全散列算法的堅固性和安全性。以上對fpga的功能要求需要fpga具備微控制器的性能，例如picoblaze，它是xilinx專用于spartan-3，virtex-ii，virtex-ii pro，virtex-4 fpga和coolrunner-ii cpld的自由宏。picoblaze使用192個邏輯單元，僅為spartan-3 xc3s200器件的5%。 對fpga的身份識別及防拷貝技術(shù)的實現(xiàn) 當(dāng)器件上電后，fpga從flash prom中讀取數(shù)據(jù)對自己進行配置。配置完成后fpga的微處理器功能被啟動并進行認(rèn)證工作，該認(rèn)證工作包括下列步驟：產(chǎn)生一組隨機數(shù)并作為一個質(zhì)詢機制(q)發(fā)送給安全存儲器；向安全存儲器發(fā)出指令，要求其計算一個基于密鑰、質(zhì)詢機制、唯一識別號和固定附加數(shù)據(jù)的hash結(jié)果；fpga本身計算一個基于其自身存儲密鑰、發(fā)送給安全存儲器的相同數(shù)據(jù)和固定附加數(shù)據(jù)的期望hash結(jié)果(e)；讀取由安全存儲器件所計算出的hash
聲參考時鐘倍頻器允許用低成本、低頻外部時鐘作為系統(tǒng)時鐘，同時仍可提供優(yōu)良的動態(tài)性能；支持測試向量和幅度斜坡式控制功能。 3系統(tǒng)設(shè)計與實現(xiàn) 系統(tǒng)具體實現(xiàn)框圖如圖3所示。硬件設(shè)計主要包括外圍控制、fpga、ad9957和濾波放大電路。 3.1外圍控制模塊設(shè)計 外圍控制模塊主要由pc機和相應(yīng)的外圍控制電路組成，主要用來控制主、次側(cè)音的選擇及主、次側(cè)音所對應(yīng)的調(diào)相指數(shù)的選擇。 3.2 fpga設(shè)計 本設(shè)計中fpga(現(xiàn)場可編程門陣列)采用xilinx公司生產(chǎn)的xc3s200，主要應(yīng)用了vhdl可編程語言編寫核心處理模塊的硬件開發(fā)程序，其中包括時鐘產(chǎn)生模塊、側(cè)音生成模塊和初始化模塊3個模塊的設(shè)計。如圖4所示。 時鐘產(chǎn)生模塊(clk_module)主要用來提供系統(tǒng)所需的統(tǒng)一工作時鐘及ad9957所需要的差分時鐘clk_p和clk_n，并為系統(tǒng)提供復(fù)位信號。 側(cè)音生成模塊(ceyin_module)中采用xilinx公司提供的dds ip core直接產(chǎn)生所需主側(cè)音和虛擬次側(cè)音，通過計算控制字作為dds的輸入，即可得出相應(yīng)頻率的正弦信號輸出，再與外圍
fpga我現(xiàn)在有一個成品板,fpga芯片是xc3s200,配置采用xcf01s,但是xc3s200的51腳卻接到了xcf01s的11腳,不知道這樣的接法有什么影響,望各位大俠不吝指教,謝謝!
不知道，最簡單的xc3s200估計元器件成本500元
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