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歷史最低報(bào)價(jià)：￥15.5000 歷史最高報(bào)價(jià)：￥15.5000 歷史平均報(bào)價(jià)：￥15.5000
卡為實(shí)現(xiàn)８位ａ／ｄ和３２位ｐｃｉ總線的寬度匹配，采用了位擴(kuò)展技術(shù)。為加深ｆｉｆｏ的緩沖深度，將外加ｆｉｆｏ緩存與ｐｃｉ接口芯片內(nèi)部的ｆｉｆｏ相級連。 ２．４ 基于ｃｐｌｄ的控制邏輯 基于ｃｐｌｄ的控制邏輯是高速數(shù)據(jù)采集卡的核心，它為ｐｃｉ接口芯片提供滿足時(shí)序要求的讀寫信號，同時(shí)選擇模擬信號的輸入通道、控制高壓脈沖發(fā)生邏輯并設(shè)定放大電路的增益。此外，ｃｐｌｄ還能利用高速ｆｉｆｏ緩存的空、滿標(biāo)志位，配合ｐｃｉ接口芯片實(shí)現(xiàn)ｄｍａ寫操作，完成高速數(shù)據(jù)傳輸。ｘｉｌｉｎｘ 公司的ｘｃ９５７２ｘｌ－ｖｑ６４xc9572xl-vq64芯片的腳到腳延遲最大為１０ｎｓ，可滿足ｐｃｉ總線接口時(shí)序的要求。單片ｘｃ９５７２ｘｌ－ｖｑ６４能滿足焊縫缺陷自動超聲檢測系統(tǒng)邏輯控制的要求，且具有體積小、可靠性高、調(diào)試方便等突出優(yōu)點(diǎn)。 圖２是基于有限狀態(tài)機(jī)ｆｓｍ（ｆｉｎｉｔｅ ｓｔａｔｅ ｍａｃｈｉｎｅ）方法設(shè)計(jì)的控制邏輯狀態(tài)轉(zhuǎn)換圖。其中，ｒｓｔ和ｉｒｑ是由ｐｃｉ接口芯片ｓ５９３３輸出的可由程序任意控制的兩個(gè)信號，它們的高低狀態(tài)同高速ｆｉｆｏ緩存的空、滿信號一起決定了控制邏輯的六個(gè)可能的狀態(tài)，圖中以橢圓表示。計(jì)算機(jī)上電時(shí)，控制邏輯處于ｒｓｔ＝
XC9801 XC9801/02 XCF01 XCF01S XCF01SV020 XCF01SVO20 XCF02 XCF02S XCF04S XCM406
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