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用于天文觀測的CCD相機系統(tǒng)的研究
封裝，可通過jtag接口實現(xiàn)在線編程。我們選用emp7128slc84-15，通過硬件描述語言（vhdl）在集成開發(fā)環(huán)境max plus ii下完成邏輯設計；編譯后，通過jtag接口下載到電路板上的epm7128slc84-15中，實現(xiàn)了kaf-0401le芯片的時序要求。 max plus ii雖然有很豐富的元件庫，但并不是針對某一應用而開發(fā)的，具有通用性，調用它固有的元件庫可能造成資源的浪費，沒有必要。因此我們按照需求，編制了自己的元件庫，然后在程序中作為元件調用。在本系統(tǒng)中，僅用1片epm7128lc84-15就實現(xiàn)了ccd的時序要求、暫存ram和接口擴展芯片8255的片選和地址譯碼，既簡化恥電路的硬件設計，提高了系統(tǒng)可靠性，又降低了成本。交流時序條件要求。描述符號最小值正常值最大值φh1、φh2時鐘頻率/mhzfh 1015φv1、φv2時鐘頻率/khzfv 100125周期/nste67100 φh1、φh2建立時間/μstφhs0.51 φv1、φv2脈沖/μstφv45 復位時鐘脈寬/nstφr1020 讀出時間/mstreadout3450 每行讀出時間/μstline65.895.
基于CPLD的片內振蕩器設計
配到同一個lab中。(3)打開"slow slew rate"以降低開關噪聲，打開"xor synthesis"以減少芯片面積的占用。 3 電路仿真及測試結果本文以altera公司的max+plus ii 10.2為設計工具，在max7000s系列芯片上實現(xiàn)并測試。圖3為選用emp7128lc84-15芯片的時序仿真結果。其中p0～p7分別為環(huán)形振蕩電路中單個門之后的電路節(jié)點；oscena[7…0]為各延時門電路的控制端(即所有二輸入門中多余的輸入端)。表1列出了以epm7128lc84-15為目標芯片、采用tektronic tds2012示波器對用不同門數(shù)實現(xiàn)的片內振蕩器的測試數(shù)據(jù)。f1和f2分別表示片內振蕩器輸出和二分頻輸出的測量數(shù)據(jù)。圖4給出了測量數(shù)據(jù)的曲線。表1數(shù)據(jù)表明，通過增加門電路的數(shù)量可以有規(guī)律地減小振蕩電路的工作頻率，由每個邏輯單元實現(xiàn)的門電路單元延時tpd在7.5～10ns之間。本文介紹的基于cpld的片內振蕩器設計方法，在改變該振蕩器電路中門電路數(shù)量時，可以有規(guī)律地將振蕩頻率控制在8mhz～62mhz范圍內。振蕩器

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