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當(dāng)前位置：維庫電子市場網(wǎng)>IC>ep2s15f484c5 更新時間:2025-08-31 16:01:23

ep2s15f484c5供應(yīng)商優(yōu)質(zhì)現(xiàn)貨

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歷史最低報價：￥120.0000 歷史最高報價：￥950.0000 歷史平均報價：￥545.7142

ep2s15f484c5中文資料

  • 基于多路移相時鐘的瞬時測頻模塊設(shè)計

    臺，能滿足脈內(nèi)測頻的要求，能進(jìn)行遠(yuǎn)程通信，并有一定的移植型和升級性。 整個系統(tǒng)的工作機(jī)理是：操作人員通過上位機(jī)人機(jī)界面對該模塊進(jìn)行參數(shù)設(shè)置和功能選擇，人機(jī)界面的設(shè)定值通過串口傳輸?shù)絾纹瑱C(jī)，單片機(jī)作為測量模塊的控制部件，控制fpga完成相應(yīng)的測量任務(wù)，fpga負(fù)責(zé)具體測頻算法實(shí)現(xiàn)。測試完成后，測試結(jié)果通過單片機(jī)傳送給上位機(jī)人機(jī)界面顯示，兩者通過rs232串口連接。整個設(shè)計中fpga內(nèi)部的測頻算法電路為核心電路。 3 fpga測頻算法電路設(shè)計 采用altera公司stratixii系列ep2s15f484c5型fpga為核心控制單元。內(nèi)部的測頻算法電路主要包括pll輸出時鐘的走線、時序控制單元、數(shù)據(jù)處理單元。這些單元是實(shí)現(xiàn)測頻算法的核心，需要將各單元按相互提供的接口在fpga內(nèi)部進(jìn)行連接，構(gòu)成完整的測頻模塊，實(shí)現(xiàn)等精度測頻功能。輸入信號分別為10 mhz的時鐘信號、脈沖包絡(luò)信號和被測信號；輸出信號為時鐘計數(shù)值和ns被測信號計數(shù)值nx。 利用pll輸出多路計數(shù)時鐘，可在fpga內(nèi)部通過pll級聯(lián)的方式增大最大倍頻數(shù)。首先利用epll將恒溫晶振輸入的10 mhz時鐘倍頻到50 mhz，傳輸給fpl

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