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Altera
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ataclk）、場同步（vs0ut）和行同步（hsout）信號給fpga，dsp通過i c總線對tvp70025i內(nèi)部寄存器進行初始化設置，并啟動模數(shù)轉(zhuǎn)換過程。 圖2 tvp70025i硬件連接 2.1.2 機載端dsp+fpga處理器 機載端處理部分主要完成數(shù)字視頻信號獲取、視頻壓縮編碼和遙控遙測接口功能，考慮到dsp強大的數(shù)字信號處理能力和fpga 的大規(guī)模邏輯設計能力，系統(tǒng)采用fpga+dsp的硬件架構。 fpga 選用altera 公司stratixii 系列芯片ep2s30f672c5，該芯片有豐富的邏輯資源和嵌人式存儲器，支持lvttl、lvds等接口電平標準。主要功能設計如圖3所示。 圖3 fpga功能設計 包括以下3個方面： 1）數(shù)字視頻獲取 fpga通過tvp70025i輸出的場同步和行同步信號判斷一場和一行視頻的起始，接收原始視頻數(shù)據(jù)（y／cb／cr）并存人fpga 內(nèi)部開辟的fifo之中，考慮到數(shù)據(jù)傳輸?shù)母咝?，需緩存若干行圖像并一次性傳遞至dsp，由于fpga內(nèi)部存儲器有限，故外掛sram 作為數(shù)據(jù)緩沖。 2）dsp與fpga間數(shù)據(jù)
帶寬和峰均比。預失真處理完畢后的數(shù)字信號通過一片雙通道14位d／a轉(zhuǎn)換芯片轉(zhuǎn)換成模擬信號，上變頻后送入功放；要達到預失真器自適應的效果，fpga芯片還需要一路能反映功放非線性特性的反饋信號，為此，我們從功放的輸出信號中耦合一部分出來，用收信機(rx)做下變頻，通過a／d轉(zhuǎn)換芯片轉(zhuǎn)換成數(shù)字信號送入fpga。由于大部分信號發(fā)生器都可以將模擬低頻i、q信號調(diào)制到高頻，在驗證過程中用它做上變頻器可以省掉一臺發(fā)信機，簡化了系統(tǒng)。 整個驗證平臺中，fpga芯片使用的是altera公司的ep2s30f672c5。此芯片內(nèi)含約137×104bit存儲空間，3×104多個邏輯單元，64個18位乘法器，內(nèi)部時鐘最高可達550 mhz，大多數(shù)算法都可以在其中實現(xiàn)。a／d轉(zhuǎn)換芯片可以達到采樣速率65 msps(百萬次采樣每秒)、信噪比74 db和sndr 83db，完全能夠滿足多載波wcdma和cdma2000信號的采樣要求。整個平臺如圖3所示。模擬基帶信號上變頻由agilent公司的信號發(fā)生器esg4432完成。 2 數(shù)字預失真仿真與測試結果對比 從圖1中可以看到，地址產(chǎn)生模塊和復數(shù)乘
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