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IRIG-B格式時間碼解碼接口卡電路設計
內程序死循環(huán)，在該板上設計了看門狗復位電路。在單片機板內程序中，每隔一定時間對p1.6口進行置1。計時器的最高位輸出端接至單片機的reset端。在正常情況下，p1.6口總能執(zhí)行置1操作，不會對單片機復位；但若程序中有死循環(huán)，則p1.6口不被置1。當計時器計到最高位輸出端為1時，就會對單片機復位?？撮T狗復位電路采用14位二進制計數器4060，并具備上電復位和手動復位的功能，其振蕩周期由外接電阻、電容的大小決定。 2 電路設計方案2 方案2如圖4所示。解碼原理同方案1。該電路采用fifo（idt7201）加狀態(tài)寄存器和緩沖器，實現單片機與主計算機之間的數據傳輸，無需8255和鎖存器，器件較少，但相應地會增加軟件控制的工作量。單片機解碼后，在每幀數據前加上標志碼，輸出時、分、秒、毫秒信息，在寫信號的控制下，經緩沖器送入fifo中。主計算機查詢狀態(tài)寄存器，了解fifo的狀態(tài)（空、滿、半滿）后，讀取fifo中的數據。這里用fifo的8位數據線。 idt7201為先進先出雙口存儲器。內部ram：512×9，設有空標志（ef）、滿標志（ff）和半滿標志（hf），以避免數據溢出和空讀。讀、寫數據通過
基于TMS320C542話音處理卡研制的多通道語音記錄系統(tǒng)
這使性能更好的語音壓縮算法可以應用于多路語音壓縮系統(tǒng)。本項目采用了美國德州儀器（ti）的dsp芯片tms320c542pge-40，完成了在gsm系統(tǒng)中使用的規(guī)則脈沖激勵－長時線性預測（rpe-ltp）算法，實現了高效率的多通道語音記錄系統(tǒng)。硬件結構硬件框圖如圖1所示。系統(tǒng)硬件包括’c542、擴展ram、isa總線接口、模擬接口、擴展接口（虛線框中部分）五大部分。其中，模擬接口（adc）為tms320ac01，擴展ram為tc55b8016，兩者都是ti的產品。fifo為idt公司的idt7201。 ’c542是系統(tǒng)的核心部件，它的功能是進行底層硬件的管理和語音數據的壓縮?！痗542是ti公司于1995年推出的面向移動通信的新一代產品。它采用改進的哈佛體系結構，集成了許多并行處理單元，使它特別適合完成高復雜度的算法。本系統(tǒng)采用的’c542具有40mips的運算能力?！痗542還具有幾種高效的片內外設：1個64k×16的并口，2個同步串口，1個8位的主機接口（hpi）和1個定時器。它能響應5個中斷，具有總線掛起功能。’c542豐富的片內外設極大地減省了片外電路。模擬接口由以主從