IDT7206L25JI
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CMOS ASYNCHRONOUS FIFO 2048 x 9, 409...
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CMOS ASYNCHRONOUS FIFO 2048 x 9, 409...
IDT [Integrated Device Technology]
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CMOS ASYNCHRONOUS FIFO 2048 x 9, 409...
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器中。該設計方案選用fpga作為主模塊,主要是考慮fpga現場可編程特性,使用靈活方便,能夠降低硬件電路設計難度。 2.2 系統硬件設計 多通道同步數據采集存儲系統結構框圖如圖1所示,主要包括以下部分: (1)多通道同步數據采集模塊 選用ad781采樣保持器完成多通道數據采樣保持,滿足系統要求。a/d轉換器選用16位的ads8401,可提高采樣精度,有利于分析采集數據。 (2)大容量存儲模塊 采用sumsung公司的k9k8g08u0m型flash作為存儲器,使用idt7206作為采集數據緩存。 (3)外圍電路 主要包括晶振、電壓轉換器tps70358及輸入輸出接口等。 其中,系統采集的重點是實現多通道數據的同步實時采集,其主要邏輯由fpga主控模塊控制。存儲模塊中所采用的壞塊檢測技術,可提高flash存儲的可靠性。 3 多通道同步數據的采集 在執(zhí)行多通道同步數據采集時,其電路如圖2所示。其主要工作流程:多路模擬信號經運放調理電路后進入采樣保持器。在每個周期的開始,fpga通過編程輸出脈沖至采樣保持器(ad781)和模擬電子開關(adg706)
通過pc機并口完成數據通信。此方案與采用a/d數據采集卡的監(jiān)測方式相比,性價比和精度均較高。 關鍵詞:扭振監(jiān)測 脈沖時序計數 可編程器件 跟蹤濾波 峰值監(jiān)測1 總體設計監(jiān)測儀總體結構如圖1中虛線框部分所示。圖中的轉子軸屬機械裝置,一端開有鍵相槽,另一端安裝齒盤。計數器、鎖存器、管理邏輯、寫fifo接口及數據轉換接口采用xilinx公司的cpld xc95288實現。 儀器的輸入設計為四通道電渦流傳感器信號輸入。計數器為24位,外加8位四通道狀態(tài)信息,形成32位數據線。fifo采用四片idt7206接收32位數據。數據轉換接口完成32位數據讀入并將其轉成8位逐次輸出及完成相應控制邏輯。pc機通過并口采用epp模式讀入數據,并作相應計算處理。前端信號處理應用跟蹤濾波和峰值監(jiān)測技術,可抑制干擾,并能有效地跟蹤復雜環(huán)境下齒信號的時序。1.1 跟蹤濾波實際環(huán)境中常存在電氣干擾等信號,使得傳感器輸出信號發(fā)生畸變及存在毛刺等,從而影響齒信號脈沖到來時刻的計數值。所以對信號作前端處理時,需采用濾波器除掉高頻雜波等干擾信號。在傳統扭振測量中,對于轉速相對穩(wěn)定的動力設置,常應用中心頻率固定的濾波器;而當轉速