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加硬件資源消耗的情況下完成了對cat的檢測，從而大大節(jié)省了fpga內(nèi)部寶貴的邏輯資源。 經(jīng)過仔細(xì)分析對照，筆者發(fā)現(xiàn)pat表和cat表有著驚人的相似性，這種相似性給編寫硬件語言帶來了極大的便利。pat和cat的差別主要在循環(huán)字段，其他字段位置字節(jié)數(shù)都能很好對應(yīng)。若把對兩個表的循環(huán)字段的處理分別獨立為兩個小模塊，則剩下的部分就可以很好地將對pat和cat的處理融合到一起，融合到一起的模塊只需要給這兩個小模塊恰當(dāng)?shù)目刂萍纯伞?4 實際測試 本設(shè)計采用硬件平臺de2開發(fā)板，fpga型號ep2c35f672c6n，接口芯片通過de2板gpio接口和fpga相連。測試碼流有將衛(wèi)星信號轉(zhuǎn)換而得的實時碼流和人工制作的非實時碼流。對于a類情況，采用由亞洲三號衛(wèi)星頻點為4095h的信號轉(zhuǎn)換的實時碼流進行測試，如圖4所示，從左向右：數(shù)碼管數(shù)值1和3分別表示有一套節(jié)目，該套節(jié)目里有3個pid，它們是13′h0021，13′h00a0，13′h0050；三個紅色led燈亮表示發(fā)現(xiàn)pat，pmt和基本音視頻包，兩個綠色led燈亮表示接收同步及提取分析完psi信息。de2板顯示的節(jié)目數(shù)及pid值跟專業(yè)數(shù)字衛(wèi)星接收機顯示的結(jié)
口，在圖中設(shè)置好相應(yīng)項后，依次點擊1、2、3 3個按鈕，逐項執(zhí)行vhdl文件轉(zhuǎn)換、綜合、適配，即可將。mdl文件轉(zhuǎn)換為.vhd文件。同時，在工作目錄生成的文件中有tb_qpsk.tcl和tb_qpsk.v文件.tb_qpsk.v文件是在quartusii中要用到的工程文件，tb_qpsk.tcl文件是要在modesim進行rtl級仿真用到的測試代碼。仿真完成后，在quartusii中指定器件管腳、進行編譯、下載。最后進行硬件的下載，連接好fpga開發(fā)板即可。本文采用的硬件是cyclone系列芯片ep2c35f672c6n。圖4是在quartusii中qpsk的已調(diào)波形，與仿真波形基本一致。由圖可以看出，有4個相位跳變點，正確地反映了qpsk調(diào)制的特點。 圖4 qpsk的已調(diào)波形 4 結(jié)論 本文利用了現(xiàn)代dsp技術(shù)的功能，在simulink的環(huán)境下實現(xiàn)了qpsk的建模，給出了具體模型，從而避免了vhdl程序的編制，縮短了周期，提高了效率。采用該法，極大地提高了電子系統(tǒng)設(shè)計的靈活性和通用性。仿真結(jié)果和硬件實現(xiàn)都驗證了該方案的正確性。 參考文獻:[1]. mdl datasheet http://
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